Michael Metzner teilweise verfügbar

Michael Metzner

Engineer für FPGA und Embedded Software Development

teilweise verfügbar
Profilbild von Michael Metzner Engineer für FPGA und Embedded Software Development aus Potsdam
  • 14482 Potsdam Freelancer in
  • Abschluss: Diplom-Informatik
  • Stunden-/Tagessatz:
  • Sprachkenntnisse: deutsch (Muttersprache) | englisch (verhandlungssicher)
  • Letztes Update: 07.10.2020
SCHLAGWORTE
PROFILBILD
Profilbild von Michael Metzner Engineer für FPGA und Embedded Software Development aus Potsdam
DATEIANLAGEN
Lebenslauf / Projekthistorie

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SKILLS
Entwicklung von FPGA-Designs in VHDL & Co / Erfahrungen mit Altera und Xilinx FPGAs / Embedded Software-Entwicklung für µC und DSP in C/C++ / Vieles drumherum
PROJEKTHISTORIE
  • 11/2018 - bis jetzt

  • Schnittstellengerät für militärische Anwendungen
  • FPGA-basiertes Multi-Interface Gerät

    Technologien: FPGA, VHDL, Ethernet, AXI, PCIe
    Tools: Xilinx Vivado, ModelSim

  • 02/2016 - 07/2020

  • FPGA-basierte Server Hardware
  • VHDL-Entwicklung SoC

    Technologien: FPGA, VHDL, C#, C, ARM, AXI
    Tools: Xilinx Vivado, Mentor Questa, Visual Studio, TI CodeComposer

  • 01/2018 - 10/2018

  • Debuggen von Kamerasystemen und Neuentwicklung Multikamera-System
  • Debuggen vorhandener Produkte und Bugfixing
    Entwicklung des FPGA-Teils eines Multikamerasystems

    Technologien: FPGA, VHDL, C, AXI4, Ethernet
    Tools: Xilinx Vivado & SDK, Microblaze

  • 04/2018 - 05/2018

  • Portierung Intel/Altera Firmware von Cyclone II auf Cyclone 10
  • Verilog-Code Portierung auf neuere Hardware-Plattform

    Technologien: FPGA, Verilog
    Tools: Intel Quartus

  • 08/2017 - 03/2018

  • FPGA ADC Ansteuerung
  • Ansteuerung eines ADC über VHDL

    Technologien: FPGA, VHDL, C, AXI4
    Tools: Xilinx Vivado & SDK, Microblaze

  • 07/2015 - 01/2016

  • Review FPGA-IP Core nach DO-254-A
  • VHDL-, Test- und Anforderungsreview für einen Netzwerk-IP-Core für
    Luftfahrtanwendungen.

    Technologien: FPGA, VHDL, Ethernet
    Tools: VeroTrace, CVS

  • 10/2014 - 02/2015

  • Steuerungssystem Vakuumtoilette
  • Für ein bestehendes Steuerungssystem von Vakuumtoiletten für Züge wurden neue
    Features implementiert sowie ein Redesign für einzelne Systemteile durchgeführt.

    Technologien: Embedded Linux, ARM, C, C++, C#, PHP, JavaScript, SPS
    Tools: Cross-GCC, Makefiles, Visual Studio

  • 09/2014 - 09/2014

  • Portierung eines Bluetooth-Stacks
  • Für ein bestehendes ARM Linux System sollte ein Installer erstellt werden, der dem
    System Bluetooth-Funktionalitäten bereitstellt. Hierzu gehörte auch der Austausch
    des Kernels, durch einen neuen angepassten Kernel sowie die Cross-Kompilierung der benötigten Bibliotheken.

    Technologien: Embedded Linux, ARM, C, SocFPGA, Bluetooth
    Tools: Cross-GCC, Makefiles, Yocto, BlueZ

  • 01/2014 - 02/2014

  • Messe-Demonstration Multi-Device-Communication
  • Demonstration mit verschiedenen Embedded-Geräten über WLAN (u.a. Altera SoCFPGADev-Kit und PandaBoard)

    Technologien: Embedded Linux, ARM, C, Java, WLAN, SoC-FPGA
    Tools: Cross-GCC, Android, Quartus II, OpenCV

  • 01/2013 - 12/2013

  • Steuerungssystem für medizinischen Teilchenbeschleuniger
  • FPGA-Designs für verschiedene Geräte der Strahlbeschleunigung, Teilchenentnahme sowie Strahlüberwachung zur Gewährleistung des zeitsynchronen Ineinandergreifens aller Teilsysteme und der Patientensicherheit.

    Technologien: VHDL, EtherCAT, PowerPC, Java, C#, C, ARM
    Tools: Altera Quartus II, TimeQuest, SignalTap, Messtechnik, Visual Studio

  • 11/2012 - 11/2012

  • Bluetooth SW-Entwicklung OBEX
  • Für Ubuntu Linux und Android 4.1 sollte eine Software in C entwickelt werden, die es
    ermöglicht über BlueZ und OBEX mit dem PBAP (Phonebook Access Profile) per
    Bluetooth auf Kontakte von anderen Geräten zuzugreifen. Auch auf Android wurde
    über das Java Native Interface mit C entwickelt. Ziel war ein portabler Code, der auf
    beiden Systemen verwendbar war.

    Technologien: Linux, C, ARM, Android
    Tools: Cross-GCC, Makefiles, JNI

  • 07/2012 - 09/2012

  • UGV mit Echtzeitsteuerung
  • Plattformkonzept mit externen Partner aus dem Bereich mobile Trägersysteme und
    COFDM-Funk für einen Messeauftritt.

    Technologien: VHDL, SMPTE 259M, COFDM
    Tools: Altera Quartus II, TimeQuest, SignalTap, Messtechnik, Blender

  • 05/2009 - 06/2012

  • Ultra Low Delay VideoCoDec Core
  • Ein H.264-verwandter VideoCoDec als FPGA IP-Core für PAL/NTSC Videoströme miteiner Kodier/Dekodier-Latenz von < 10ms auf Low-End-FPGAs.

    Technologien: Handel-C, VHDL, C, H.264, MPEG2-TS, BT.656, ARC
    Tools: Altera Quartus II, TimeQuest, SignalTap, Modelsim, Mentor DK Design Xilinx ISE, Chipscope

  • 09/2011 - 01/2012

  • DVB-ASI Streaming Core
  • IP-Core für Altera FPGAs ab Cyclone III zur Übertragung von MPEG2 Transportstrom-Paketen über das besonders im Broadcast-Sektor verbreitete ASI Interface.

    Technologien: VHDL, C++, MPEG2, SMPTE 259M
    Tools: Altera Quartus II, TimeQuest, SignalTap, Modelsim, TS-Analyzer

ZEITLICHE UND RÄUMLICHE VERFÜGBARKEIT
Zur Zeit nur Teilzeit im Homeoffice
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Versicherungsbeginn:
01.07.2015

Versicherungsende:
01.07.2018

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